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More than 10 million cycles of harsh electrical stress put a new vertical memory transistor through its paces in a KAIST-led study. Its threshold-voltage shift stayed below 50 millivolts, a reliability result the researchers say addresses a central weakness of three-dimensional memory devices.
Plus de 10 millions de cycles de contrainte électrique intense ont mis à l’épreuve un nouveau transistor mémoire vertical dans le cadre d’une étude dirigée par KAIST. Sa variation de tension de seuil est restée inférieure à 50 millivolts, un résultat de fiabilité qui, selon les chercheurs, répond à une faiblesse centrale des dispositifs de mémoire tridimensionnels.
The problem begins with oxygen vacancies—missing oxygen atoms in an oxide semiconductor—that can destabilize a memory channel. Adding oxygen can repair the channel, but some oxygen may travel onward to the metal electrode and oxidize it. The channel needs oxygen; the electrode does not.
Le problème vient des lacunes d’oxygène — des atomes d’oxygène manquants dans un semi-conducteur à oxyde — qui peuvent déstabiliser un canal mémoire. Ajouter de l’oxygène peut réparer le canal, mais une partie de cet oxygène peut ensuite migrer vers l’électrode métallique et l’oxyder. Le canal a besoin d’oxygène ; l’électrode, non.
KAIST’s team, led by Professor Jimin Kwon, built a silicon nitride/silicon dioxide/silicon nitride layer, or SiN/SiO₂/SiN, to act as an “oxygen tunnel.” It is engineered to guide oxygen toward the vertical channel while blocking migration toward the electrode, tackling both defects and oxidation in the same structure. The researchers report high current density and data retention in the oxide vertical channel transistor, although the article does not provide the underlying numerical values for those measures.
L’équipe de KAIST, dirigée par le professeur Jimin Kwon, a conçu une couche de nitrure de silicium/dioxyde de silicium/nitrure de silicium, ou SiN/SiO₂/SiN, pour servir de « tunnel à oxygène ». Elle est conçue pour guider l’oxygène vers le canal vertical tout en bloquant sa migration vers l’électrode, afin de traiter à la fois les défauts et l’oxydation au sein d’une même structure. Les chercheurs font état d’une forte densité de courant et d’une bonne conservation des données dans le transistor à canal vertical en oxyde, même si l’article ne fournit pas les valeurs numériques sous-jacentes pour ces mesures.
The team then combined the oxide-semiconductor device with conventional silicon CMOS—complementary metal-oxide-semiconductor logic—to assess compute-in-memory, or CIM, systems that perform AI computation directly inside memory. The results suggest that the structure could support faster, more power-efficient AI semiconductors.
L’équipe a ensuite combiné le dispositif à semi-conducteur à oxyde avec du CMOS au silicium conventionnel — une logique à semi-conducteurs complémentaires métal-oxyde — afin d’évaluer des systèmes de compute-in-memory, ou CIM, qui exécutent les calculs d’IA directement dans la mémoire. Les résultats suggèrent que la structure pourrait permettre de concevoir des semi-conducteurs d’IA plus rapides et plus économes en énergie.
So what changes in practice? If the reliability result survives further testing and manufacturing, vertically stacked memory could become easier to use alongside silicon logic in AI hardware, reducing one obstacle to keeping data close to computation. For now, the concrete advance is narrower and more solid: a laboratory structure that controls oxygen migration and keeps a 3D memory transistor stable under repeated electrical stress.
Qu’est-ce que cela change en pratique ? Si le résultat de fiabilité résiste à de nouveaux essais et à la fabrication, la mémoire empilée verticalement pourrait être plus facile à utiliser aux côtés de la logique au silicium dans le matériel d’IA, en réduisant un obstacle à la conservation des données à proximité du calcul. Pour l’instant, l’avancée concrète est plus limitée, mais plus solide : une structure de laboratoire qui contrôle la migration de l’oxygène et maintient la stabilité d’un transistor mémoire 3D soumis à des contraintes électriques répétées.